关于alter_pll的问题
我用quartus生成了一个pll的IP core，然后想用NC_verilog仿真，但是在生成的VO文件中调用了一个叫altera_pll的模块，然后我在altera_mf中和其他库中没有找到这个东西，请问这个怎么仿真
我用quartus生成了一个pll的IP core，然后想用NC_verilog仿真，但是在生成的VO文件中调用了一个叫altera_pll的模块，然后我在altera_mf中和其他库中没有找到这个东西，请问这个怎么仿真
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